]> git.ipfire.org Git - people/ms/u-boot.git/blame - board/aries/mcvevk/qts/pinmux_config.h
Merge branch 'master' of git://git.denx.de/u-boot-socfpga
[people/ms/u-boot.git] / board / aries / mcvevk / qts / pinmux_config.h
CommitLineData
d88995a8
MV
1/*
2 * Altera SoCFPGA PinMux configuration
3 *
4 * SPDX-License-Identifier: BSD-3-Clause
5 */
6
7#ifndef __SOCFPGA_PINMUX_CONFIG_H__
8#define __SOCFPGA_PINMUX_CONFIG_H__
9
10const u8 sys_mgr_init_table[] = {
11 3, /* EMACIO0 */
12 3, /* EMACIO1 */
13 3, /* EMACIO2 */
14 3, /* EMACIO3 */
15 3, /* EMACIO4 */
16 3, /* EMACIO5 */
17 3, /* EMACIO6 */
18 3, /* EMACIO7 */
19 3, /* EMACIO8 */
20 3, /* EMACIO9 */
21 3, /* EMACIO10 */
22 3, /* EMACIO11 */
23 3, /* EMACIO12 */
24 3, /* EMACIO13 */
25 0, /* EMACIO14 */
26 0, /* EMACIO15 */
27 0, /* EMACIO16 */
28 0, /* EMACIO17 */
29 0, /* EMACIO18 */
30 0, /* EMACIO19 */
31 3, /* FLASHIO0 */
32 0, /* FLASHIO1 */
33 3, /* FLASHIO2 */
34 3, /* FLASHIO3 */
35 3, /* FLASHIO4 */
36 3, /* FLASHIO5 */
37 3, /* FLASHIO6 */
38 3, /* FLASHIO7 */
39 0, /* FLASHIO8 */
40 3, /* FLASHIO9 */
41 3, /* FLASHIO10 */
42 3, /* FLASHIO11 */
43 0, /* GENERALIO0 */
44 1, /* GENERALIO1 */
45 1, /* GENERALIO2 */
46 0, /* GENERALIO3 */
47 0, /* GENERALIO4 */
48 1, /* GENERALIO5 */
49 1, /* GENERALIO6 */
50 1, /* GENERALIO7 */
51 1, /* GENERALIO8 */
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61 1, /* GENERALIO18 */
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69 0, /* GENERALIO26 */
70 0, /* GENERALIO27 */
71 0, /* GENERALIO28 */
72 0, /* GENERALIO29 */
73 0, /* GENERALIO30 */
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75 0, /* MIXED1IO0 */
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84 1, /* MIXED1IO9 */
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87 0, /* MIXED1IO12 */
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89 0, /* MIXED1IO14 */
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91 1, /* MIXED1IO16 */
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94 0, /* MIXED1IO19 */
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97 0, /* MIXED2IO0 */
98 0, /* MIXED2IO1 */
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100 0, /* MIXED2IO3 */
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104 0, /* MIXED2IO7 */
105 0, /* GPLINMUX48 */
106 0, /* GPLINMUX49 */
107 0, /* GPLINMUX50 */
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110 0, /* GPLINMUX53 */
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117 0, /* GPLINMUX60 */
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122 0, /* GPLINMUX65 */
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133 1, /* GPLMUX5 */
134 1, /* GPLMUX6 */
135 1, /* GPLMUX7 */
136 1, /* GPLMUX8 */
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138 1, /* GPLMUX10 */
139 1, /* GPLMUX11 */
140 1, /* GPLMUX12 */
141 1, /* GPLMUX13 */
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143 1, /* GPLMUX15 */
144 1, /* GPLMUX16 */
145 1, /* GPLMUX17 */
146 1, /* GPLMUX18 */
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151 1, /* GPLMUX23 */
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153 1, /* GPLMUX25 */
154 1, /* GPLMUX26 */
155 1, /* GPLMUX27 */
156 1, /* GPLMUX28 */
157 1, /* GPLMUX29 */
158 1, /* GPLMUX30 */
159 1, /* GPLMUX31 */
160 1, /* GPLMUX32 */
161 1, /* GPLMUX33 */
162 1, /* GPLMUX34 */
163 1, /* GPLMUX35 */
164 1, /* GPLMUX36 */
165 1, /* GPLMUX37 */
166 1, /* GPLMUX38 */
167 1, /* GPLMUX39 */
168 1, /* GPLMUX40 */
169 1, /* GPLMUX41 */
170 1, /* GPLMUX42 */
171 1, /* GPLMUX43 */
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181 1, /* GPLMUX53 */
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183 1, /* GPLMUX55 */
184 1, /* GPLMUX56 */
185 1, /* GPLMUX57 */
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189 1, /* GPLMUX61 */
190 1, /* GPLMUX62 */
191 1, /* GPLMUX63 */
192 1, /* GPLMUX64 */
193 1, /* GPLMUX65 */
194 1, /* GPLMUX66 */
195 1, /* GPLMUX67 */
196 1, /* GPLMUX68 */
197 1, /* GPLMUX69 */
198 1, /* GPLMUX70 */
199 0, /* NANDUSEFPGA */
200 0, /* UART0USEFPGA */
201 0, /* RGMII1USEFPGA */
202 0, /* SPIS0USEFPGA */
203 0, /* CAN0USEFPGA */
204 0, /* I2C0USEFPGA */
205 0, /* SDMMCUSEFPGA */
206 0, /* QSPIUSEFPGA */
207 0, /* SPIS1USEFPGA */
208 0, /* RGMII0USEFPGA */
209 1, /* UART1USEFPGA */
210 0, /* CAN1USEFPGA */
211 0, /* USB1USEFPGA */
212 0, /* I2C3USEFPGA */
213 0, /* I2C2USEFPGA */
214 0, /* I2C1USEFPGA */
215 0, /* SPIM1USEFPGA */
216 0, /* USB0USEFPGA */
217 0 /* SPIM0USEFPGA */
218};
219#endif /* __SOCFPGA_PINMUX_CONFIG_H__ */