include/dt-bindings/reset/xlnx-zynqmp-resets.h

   1 /* SPDX-License-Identifier: GPL-2.0 */
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   3  *  Copyright (C) 2018 Xilinx, Inc.
   4  */
   5
   6 #ifndef _DT_BINDINGS_ZYNQMP_RESETS_H
   7 #define _DT_BINDINGS_ZYNQMP_RESETS_H
   8
   9 #define         ZYNQMP_RESET_PCIE_CFG           0
  10 #define         ZYNQMP_RESET_PCIE_BRIDGE        1
  11 #define         ZYNQMP_RESET_PCIE_CTRL          2
  12 #define         ZYNQMP_RESET_DP                 3
  13 #define         ZYNQMP_RESET_SWDT_CRF           4
  14 #define         ZYNQMP_RESET_AFI_FM5            5
  15 #define         ZYNQMP_RESET_AFI_FM4            6
  16 #define         ZYNQMP_RESET_AFI_FM3            7
  17 #define         ZYNQMP_RESET_AFI_FM2            8
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  19 #define         ZYNQMP_RESET_AFI_FM0            10
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  26 #define         ZYNQMP_RESET_ACPU3_PWRON        17
  27 #define         ZYNQMP_RESET_ACPU2_PWRON        18
  28 #define         ZYNQMP_RESET_ACPU1_PWRON        19
  29 #define         ZYNQMP_RESET_ACPU0_PWRON        20
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