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drm/i915: Hook in display GTT faults for IVB/HSW
authorVille Syrjälä <ville.syrjala@linux.intel.com>
Mon, 17 Feb 2025 07:00:43 +0000 (09:00 +0200)
committerVille Syrjälä <ville.syrjala@linux.intel.com>
Mon, 17 Feb 2025 23:25:09 +0000 (01:25 +0200)
Dump out the display fault information from the IVB/HSW
error interrupt handler.

Bspec: 8203
Reviewed-by: Vinod Govindapillai <vinod.govindapillai@intel.com>
Signed-off-by: Ville Syrjälä <ville.syrjala@linux.intel.com>
Link: https://patchwork.freedesktop.org/patch/msgid/20250217070047.953-5-ville.syrjala@linux.intel.com
drivers/gpu/drm/i915/display/intel_display_irq.c
drivers/gpu/drm/i915/i915_reg.h

index 8c73dc8723848141cbb637b1801be0e9e47dceb6..cd53008ab5908522379a6a11f2cebca5b056af87 100644 (file)
@@ -720,6 +720,39 @@ static void ibx_irq_handler(struct drm_i915_private *dev_priv, u32 pch_iir)
                intel_pch_fifo_underrun_irq_handler(display, PIPE_B);
 }
 
+static u32 ivb_err_int_pipe_fault_mask(enum pipe pipe)
+{
+       switch (pipe) {
+       case PIPE_A:
+               return ERR_INT_SPRITE_A_FAULT |
+                       ERR_INT_PRIMARY_A_FAULT |
+                       ERR_INT_CURSOR_A_FAULT;
+       case PIPE_B:
+               return ERR_INT_SPRITE_B_FAULT |
+                       ERR_INT_PRIMARY_B_FAULT |
+                       ERR_INT_CURSOR_B_FAULT;
+       case PIPE_C:
+               return ERR_INT_SPRITE_C_FAULT |
+                       ERR_INT_PRIMARY_C_FAULT |
+                       ERR_INT_CURSOR_C_FAULT;
+       default:
+               return 0;
+       }
+}
+
+static const struct pipe_fault_handler ivb_pipe_fault_handlers[] = {
+       { .fault = ERR_INT_SPRITE_A_FAULT, .handle = handle_plane_fault, .plane_id = PLANE_SPRITE0, },
+       { .fault = ERR_INT_PRIMARY_A_FAULT, .handle = handle_plane_fault, .plane_id = PLANE_PRIMARY, },
+       { .fault = ERR_INT_CURSOR_A_FAULT, .handle = handle_plane_fault, .plane_id = PLANE_CURSOR, },
+       { .fault = ERR_INT_SPRITE_B_FAULT, .handle = handle_plane_fault, .plane_id = PLANE_SPRITE0, },
+       { .fault = ERR_INT_PRIMARY_B_FAULT, .handle = handle_plane_fault, .plane_id = PLANE_PRIMARY, },
+       { .fault = ERR_INT_CURSOR_B_FAULT, .handle = handle_plane_fault, .plane_id = PLANE_CURSOR, },
+       { .fault = ERR_INT_SPRITE_C_FAULT, .handle = handle_plane_fault, .plane_id = PLANE_SPRITE0, },
+       { .fault = ERR_INT_PRIMARY_C_FAULT, .handle = handle_plane_fault, .plane_id = PLANE_PRIMARY, },
+       { .fault = ERR_INT_CURSOR_C_FAULT, .handle = handle_plane_fault, .plane_id = PLANE_CURSOR, },
+       {}
+};
+
 static void ivb_err_int_handler(struct drm_i915_private *dev_priv)
 {
        struct intel_display *display = &dev_priv->display;
@@ -729,7 +762,15 @@ static void ivb_err_int_handler(struct drm_i915_private *dev_priv)
        if (err_int & ERR_INT_POISON)
                drm_err(&dev_priv->drm, "Poison interrupt\n");
 
+       if (err_int & ERR_INT_INVALID_GTT_PTE)
+               drm_err_ratelimited(display->drm, "Invalid GTT PTE\n");
+
+       if (err_int & ERR_INT_INVALID_PTE_DATA)
+               drm_err_ratelimited(display->drm, "Invalid PTE data\n");
+
        for_each_pipe(dev_priv, pipe) {
+               u32 fault_errors;
+
                if (err_int & ERR_INT_FIFO_UNDERRUN(pipe))
                        intel_cpu_fifo_underrun_irq_handler(display, pipe);
 
@@ -739,6 +780,11 @@ static void ivb_err_int_handler(struct drm_i915_private *dev_priv)
                        else
                                hsw_pipe_crc_irq_handler(dev_priv, pipe);
                }
+
+               fault_errors = err_int & ivb_err_int_pipe_fault_mask(pipe);
+               if (fault_errors)
+                       intel_pipe_fault_irq_handler(display, ivb_pipe_fault_handlers,
+                                                    pipe, fault_errors);
        }
 
        intel_de_write(display, GEN7_ERR_INT, err_int);
index 3a936a4aa2e884813772adab2ecc4f9dc900445f..b8756e5d2cae917984bbdead4d5bc4280f43a4d2 100644 (file)
 
 #define GEN7_ERR_INT   _MMIO(0x44040)
 #define   ERR_INT_POISON               (1 << 31)
+#define   ERR_INT_INVALID_GTT_PTE      (1 << 29)
+#define   ERR_INT_INVALID_PTE_DATA     (1 << 28)
+#define   ERR_INT_SPRITE_C_FAULT       (1 << 23)
+#define   ERR_INT_PRIMARY_C_FAULT      (1 << 22)
+#define   ERR_INT_CURSOR_C_FAULT       (1 << 21)
+#define   ERR_INT_SPRITE_B_FAULT       (1 << 20)
+#define   ERR_INT_PRIMARY_B_FAULT      (1 << 19)
+#define   ERR_INT_CURSOR_B_FAULT       (1 << 18)
+#define   ERR_INT_SPRITE_A_FAULT       (1 << 17)
+#define   ERR_INT_PRIMARY_A_FAULT      (1 << 16)
+#define   ERR_INT_CURSOR_A_FAULT       (1 << 15)
 #define   ERR_INT_MMIO_UNCLAIMED       (1 << 13)
 #define   ERR_INT_PIPE_CRC_DONE_C      (1 << 8)
 #define   ERR_INT_FIFO_UNDERRUN_C      (1 << 6)