From: Richard Ball Date: Fri, 16 Jan 2026 12:19:01 +0000 (+0000) Subject: arm: Fix MVE vmlas encoding X-Git-Tag: binutils-2_46~242 X-Git-Url: http://git.ipfire.org/cgi-bin/gitweb.cgi?a=commitdiff_plain;h=542ed77ff7b1173843f3ea73650dccfb90a47047;p=thirdparty%2Fbinutils-gdb.git arm: Fix MVE vmlas encoding Continuation of fix to VMLA Bit 12 of the first halfword in the VMLAS instruction is listed as (0) in the ARMARM (document DDI0553B.w, version ID07072023). This means that the instruction does not discriminate between signed and unsigned types and processing elements do not use the bit. The encoding used by gas was based on an older version of the document that made the sign important. This change makes it possible to use vmlas.i8 (16,32) in addition to vmlas.u8 and vmlas.s8 mnemonics, with the i8, i16 and i32 aliases becoming the default when disassembling. The generated encoding sets bit 12 to 0, compatibly with other assembler implementations. --- diff --git a/gas/config/tc-arm.c b/gas/config/tc-arm.c index fc93c2e8daa..04bccaff430 100644 --- a/gas/config/tc-arm.c +++ b/gas/config/tc-arm.c @@ -16032,7 +16032,7 @@ do_mve_vmlas (void) { enum neon_shape rs = neon_select_shape (NS_QQR, NS_NULL); struct neon_type_el et - = neon_check_type (3, rs, N_EQK, N_EQK, N_SU_MVE | N_KEY); + = neon_check_type (3, rs, N_EQK, N_EQK, N_SU_MVE | N_I_MVE | N_KEY); if (inst.operands[2].reg == REG_PC) as_tsktsk (MVE_BAD_PC); @@ -16044,7 +16044,7 @@ do_mve_vmlas (void) else inst.pred_insn_type = MVE_OUTSIDE_PRED_INSN; - inst.instruction |= (et.type == NT_unsigned) << 28; + inst.instruction |= (et.type == NT_untyped) << 28; inst.instruction |= HI1 (inst.operands[0].reg) << 22; inst.instruction |= neon_logbits (et.size) << 20; inst.instruction |= LOW4 (inst.operands[1].reg) << 16; diff --git a/gas/testsuite/gas/arm/mve-vmlas.d b/gas/testsuite/gas/arm/mve-vmlas.d index 0e2ee15a2ff..df374da80d5 100644 --- a/gas/testsuite/gas/arm/mve-vmlas.d +++ b/gas/testsuite/gas/arm/mve-vmlas.d @@ -5,1356 +5,2035 @@ .*: +file format .*arm.* Disassembly of section .text: -[^>]*> fe01 1e40 vmlas.u8 q0, q0, r0 -[^>]*> fe01 1e41 vmlas.u8 q0, q0, r1 -[^>]*> fe01 1e42 vmlas.u8 q0, q0, r2 -[^>]*> fe01 1e44 vmlas.u8 q0, q0, r4 -[^>]*> fe01 1e47 vmlas.u8 q0, q0, r7 -[^>]*> fe01 1e48 vmlas.u8 q0, q0, r8 -[^>]*> fe01 1e4a vmlas.u8 q0, q0, sl -[^>]*> fe01 1e4c vmlas.u8 q0, q0, ip -[^>]*> fe01 1e4e vmlas.u8 q0, q0, lr -[^>]*> fe03 1e40 vmlas.u8 q0, q1, r0 -[^>]*> fe03 1e41 vmlas.u8 q0, q1, r1 -[^>]*> fe03 1e42 vmlas.u8 q0, q1, r2 -[^>]*> fe03 1e44 vmlas.u8 q0, q1, r4 -[^>]*> fe03 1e47 vmlas.u8 q0, q1, r7 -[^>]*> fe03 1e48 vmlas.u8 q0, q1, r8 -[^>]*> fe03 1e4a vmlas.u8 q0, q1, sl -[^>]*> fe03 1e4c vmlas.u8 q0, q1, ip -[^>]*> fe03 1e4e vmlas.u8 q0, q1, lr -[^>]*> fe05 1e40 vmlas.u8 q0, q2, r0 -[^>]*> fe05 1e41 vmlas.u8 q0, q2, r1 -[^>]*> fe05 1e42 vmlas.u8 q0, q2, r2 -[^>]*> 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